欧美极品高清xxxxhd,国产日产欧美最新,无码AV国产东京热AV无码,国产精品人与动性XXX,国产传媒亚洲综合一区二区,四库影院永久国产精品,毛片免费免费高清视频,福利所导航夜趣136

 找回密碼
 立即注冊

QQ登錄

只需一步,快速開始

搜索
收藏本版 (27) |訂閱|存檔

FPGA/CPLD 今日: 0|主題: 740|排名: 30 

作者 回復/查看 最后發表
預覽 FPGA至簡設計法案例2 uid:588548 2019-7-31 09:03 02932 2023-5-30 15:19
預覽 千兆以太網設計 agree uid:900023 2021-4-2 16:10 03708 2023-5-19 23:34
預覽 EDA多功能數字鐘(源代碼) uid:51024 2014-7-30 14:06 25548 2023-5-11 23:24
預覽 VHDL四選一的結構描述 attach_img uid:833673 2023-3-17 15:42 11970 2023-5-10 15:34
預覽 基于FPGA的硬件電子琴設計(文檔+工程) attach_img agree uid:776760 2021-8-19 02:41 13709 2023-4-19 17:39
預覽 基于FPGA的超聲波測距設計 附quartus程序等 attach_img heatlevel agree uid:466735 2019-3-3 18:36 1213109 2023-4-12 15:52
預覽 FPGA實現貪吃蛇游戲源程序 VGA顯示模塊 QuartusⅡ9.1代碼 attach_img agree uid:1007214 2022-3-5 20:12 03221 2023-2-23 16:30
預覽 用VHDL編寫的籃球30秒計時器 attach_img agree uid:793816 2021-6-4 22:14 13599 2023-1-1 15:55
預覽 基于FPGA的洗衣機控制器設計 VHDL程序 attachment agree uid:816987 2020-11-30 08:52 24042 2022-12-27 16:49
預覽 FPGA電壓采集DA輸出原理圖 attach_img uid:523823 2022-12-12 15:51 02427 2022-12-12 15:51
預覽 基于VHDL語言的電子時鐘設計-ISE開發的EDA源碼 晶振25Mhz attach_img agree uid:191542 2019-1-9 21:42 36011 2022-12-11 01:48
預覽 俄羅斯方塊Verilog HDL程序設計 attachment agree uid:704585 2021-3-19 17:37 24498 2022-12-8 14:58
預覽 出租車計費器verilog HDL源程序 attach_img uid:329016 2020-11-4 20:55 24813 2022-11-29 15:27
預覽 QuartusII設計的數字日歷 附verilogHDL源程序 attach_img heatlevel agree uid:329016 2020-11-4 20:39 56769 2022-11-27 15:00
預覽 EDA智能電子搶答器的設計 attach_img agree uid:568129 2019-12-12 21:37 14382 2022-11-13 17:56
預覽 如何學習FPGA heatlevel uid:262 2013-6-14 18:51 55773 2022-10-21 10:06
預覽 如何使用AG256實現EPM240同樣功能(Altera的PLD芯片) attach_img uid:926946 2021-5-25 12:46 13667 2022-10-12 11:48
預覽 EDA設計數字頻率計(Verilog源程序) attach_img agree uid:343799 2019-6-25 22:26 16396 2022-9-18 13:11
預覽 Quartus II EDA頻率計設計 attach_img heatlevel agree uid:747475 2020-5-9 10:51 14791 2022-9-11 10:46
預覽 VHDL實現16位計數器(帶源程序) attach_img agree uid:1030457 2022-5-30 21:00 13325 2022-7-29 22:57
預覽 EDA實訓萬年歷加鬧鐘Verilog HDL程序 attach_img uid:247720 2017-12-7 20:32 36098 2022-7-14 19:54
預覽 基于FPGA的音樂播放器設計(文檔+工程) attach_img agree uid:776760 2021-8-19 02:40 13353 2022-6-22 17:10
預覽 Verilog實現維特比譯碼 attachment uid:1035196 2022-6-16 16:02 02085 2022-6-16 16:02
預覽 EDA 汽車尾燈控制器設計VHDL源碼 attach_img agree uid:292670 2018-7-1 14:11 25116 2022-6-14 18:36
預覽 VHDL四位全減器課程設計 Quartusii9.0源碼附波形仿真圖 attach_img agree uid:224298 2018-6-4 15:29 16514 2022-6-13 16:33
預覽 ZYNQ ac706學習教程 agree uid:360555 2022-5-11 14:56 02829 2022-5-11 14:56
預覽 基于FPGA的串口接收設計全過程 attach_img heatlevel uid:107189 2016-3-3 19:10 78607 2022-5-7 13:56
預覽 電子琴設計VHDL代碼 attachment agree uid:1024028 2022-5-5 14:45 02347 2022-5-5 14:45
預覽 verilog數字時鐘程序 attach_img agree uid:1023916 2022-5-5 00:31 02074 2022-5-5 00:31
預覽 VHDL數字電子鐘6位8段數碼管設計 quratus代碼 attach_img agree uid:1016839 2022-4-10 16:10 02967 2022-4-10 16:10
預覽 FPGA設計高級技巧(Xilinx) attachment uid:325686 2018-8-6 09:10 13749 2022-4-8 20:32
預覽 學FPGA/ASIC一點提醒 uid:22218 2022-3-19 11:58 02001 2022-3-19 11:58
預覽 如何使用AG256實現EPM240同樣功能(Altera的PLD芯片) attach_img uid:926946 2022-3-12 20:24 02731 2022-3-12 20:24
預覽 Verilog HDL語言在QuartusⅡ13.5軟件中將出租車計費器基本結構分成5個... attach_img agree uid:522536 2022-3-12 11:54 02002 2022-3-12 11:54
預覽 FPGA實現MD5算法 Quartus II 13.0 Verilog HDL 模塊源碼 (最大計算55字節) attach_img agree uid:57657 2022-3-9 10:20 02773 2022-3-9 10:20
預覽 VHDL語言設計四人搶答器方案源代碼 agree uid:1007564 2022-3-1 16:41 23703 2022-3-2 09:42
預覽 EDA數字頻率計設計資料(VHDL語言) attach_img agree uid:958022 2021-8-1 01:12 23663 2022-2-24 18:30
預覽 RobeiEDA關于搶答器的設計案例 attach_img agree uid:434973 2022-2-17 23:15 01895 2022-2-17 23:15
預覽 Quartus Verilog HDL/FPGA 驅動4位動態數碼管演示4位16進制累加 (每隔1秒加1) attach_img agree uid:57657 2022-1-16 09:27 23995 2022-2-16 12:38
預覽 Verilog HDL的簡單應用之74ls138功能的實現 agree uid:1003637 2022-1-27 12:17 13019 2022-2-16 08:42
預覽 CPLD作為并行接口 uid:51472 2013-7-9 04:00 15115 2022-1-27 15:21
預覽 VHDL編寫的10秒計時器 attach_img uid:793816 2021-6-4 23:30 13028 2022-1-8 21:23
預覽 基于FPGA的PLL動態輸出設計 attach_img uid:522457 2021-9-23 11:59 22384 2021-12-26 22:31
預覽 數電基于FPGA的數字時鐘的設計及仿真結果分析 attachment agree uid:465770 2019-1-10 13:58 26783 2021-12-23 15:55
預覽 手把手教你學習FPGA入門系列視頻教程,不看后悔喲 新人帖 attachment heatlevel  ...2 uid:52663 2013-8-5 10:03 4328503 2021-12-23 13:57
預覽 Quartus II Verilog HDL語言Max10OC簡易交通燈設計 初學者的小腳丫 attach_img agree uid:828188 2020-10-28 20:11 56987 2021-12-12 08:29
預覽 基于VHDL的直流電機控制系統的設計報告 attachment agree uid:263449 2018-1-17 02:44 49218 2021-12-11 19:40
預覽 FPGA實現出租車計價器 attach_img agree uid:426797 2021-6-25 15:13 13326 2021-11-12 18:58
預覽 黑金verilog那些事系列教程 attach_img agree uid:974725 2021-10-25 14:17 02914 2021-10-25 14:17
預覽 通過一個例子來講述quartus II軟件的使用 attach_img uid:443001 2018-12-10 11:17 26366 2021-9-24 09:13
下一頁 »

快速發帖

還可輸入 80 個字符
您需要登錄后才可以發帖 登錄 | 立即注冊

本版積分規則

小黑屋|51黑電子論壇 |51黑電子論壇6群 QQ 管理員QQ:125739409;技術交流QQ群281945664

Powered by 單片機教程網

返回頂部 返回版塊