JD642時(shí)鐘設(shè)計(jì)

ID:114320 · 發(fā)表于 2016-5-10 04:22

　　因?yàn)闀r(shí)鐘為高易失效元件，所以對(duì)系統(tǒng)能造成致命影響的晶體或晶振用的越少越好，合理的時(shí)鐘優(yōu)化可以很大的提高系統(tǒng)的可靠性。
　　整個(gè)系統(tǒng)時(shí)鐘需求如下：
　　1)50M晶振為DSP提供系統(tǒng)時(shí)鐘，同時(shí)為CPLD提供主時(shí)鐘。CPLD由此50M時(shí)鐘源產(chǎn)生兩路25M時(shí)鐘分別送到ICS512(為DSP提供EMIF所需的133M時(shí)鐘)和網(wǎng)絡(luò)接口芯片LXT971。
　　2)串口擴(kuò)展芯片16C2550使用11.0592M晶體。
　　3)視頻輸入芯片TVP5150使用14.31818M晶體。
　　4)視頻輸出芯片SAA7105使用27M基頻晶體。

　　因?yàn)镃PLD距DSP較遠(yuǎn)，50M時(shí)鐘走線較長(zhǎng)，經(jīng)仿真使用50歐終端并聯(lián)匹配，匹配電阻靠近DSP時(shí)鐘管腳（時(shí)鐘線遠(yuǎn)端）輸入端，50M時(shí)鐘線使用10mil寬度，P片厚度為8mil（阻抗接近50歐）。（因?yàn)檫h(yuǎn)端信號(hào)會(huì)比近端好，而DSP對(duì)時(shí)鐘占空比要求相對(duì)CPLD要高，所以把DSP放在遠(yuǎn)端，CPLD緊靠近時(shí)鐘－－50M晶振在CPLD下方。因?yàn)镈SP時(shí)鐘和CPLD時(shí)鐘相位沒有要求，所以布線可以長(zhǎng)一些，有終端匹配的話信號(hào)會(huì)沒有問題的。）

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