關(guān)于TTL電路實(shí)際應(yīng)用問題

ID:636783 · 發(fā)表于 2019-12-18 10:34

上圖是我的仿真圖沒問題，但在實(shí)際焊板時(shí)出現(xiàn)中間電平的問題。
實(shí)際焊板，在一連串的TTL邏輯芯片處理后，邏輯芯片輸出為2.2V，也就是不高不低的電平;然后經(jīng)由反饋到DQ觸發(fā)器后，觸發(fā)器呈現(xiàn)Q=Q非=2.2V的結(jié)果。請問這大概是什么問題引起的，以及有哪些解決方案？

ID:235200 · 發(fā)表于 2019-12-18 12:06

檢查芯片的帶負(fù)載能力是否滿足

ID:215444 · 發(fā)表于 2019-12-18 17:53

看下供電是不是夠，

ID:517951 · 發(fā)表于 2024-12-1 09:25

這個(gè)線路看起來眼花繚亂的的, 出現(xiàn)2.2v就是5V的中間電平, 邏輯ic是沒辦法判定是高低的那一種. 要查一下實(shí)際線路有沒有虛焊的, 短路的. 未用到的Input端口要接地, 為用到的Out端口要NC.

ID:332444 · 發(fā)表于 2024-12-1 10:24

用什么儀表測量？最好用示波器觀察與測量

ID:1108581 · 發(fā)表于 2024-12-1 12:29

成品是畫的PCB然后焊接的嗎？還是說搭棚焊的？如果不是PCB還是檢查下焊接的有沒有問題，線路有沒有焊錯(cuò)

ID:341045 · 發(fā)表于 2024-12-1 13:35

有一種可能是測到脈沖信號(hào)了。看下有懸空的輸入腳嗎？有就接個(gè)1K電阻下地再測

ID:123917 · 發(fā)表于 2024-12-1 22:00

關(guān)鍵點(diǎn)加上拉，下拉電阻應(yīng)該就可以了

ID:434018 · 發(fā)表于 2024-12-2 02:39

檢查U1 74LS175N VCC and GND腳

ID:1138682 · 發(fā)表于 2024-12-5 16:12

TTL標(biāo)準(zhǔn)輸出高電平應(yīng)該是3.6V，如果是2.2V，請使用示波器檢測是否為脈沖？普通萬用表測量結(jié)果可以理解為平均值

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