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FPGA VGA顯示 verilog源碼仿真與資料分享

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FPGA 驅動vga顯示源碼仿真與資料都有


  1. `timescale 1ns / 1ps
  2. /*==============================================================================
  3. Engineer            : a fei
  4. Module Hierarchy    : top function module
  5. Design Name         : vga_module.v
  6. Module Name         : vga_module
  7. Project Name        : test_project_top.qsf
  8. Target Devices      : Altera
  9. Tool versions       : QUARTUSII11.0/Windows XP
  10. Description         : 顯示“囧”字，綠背景，藍框,800*600@60Hz
  11. Dependencies        :                       
  12. Revision            : 0.01 - File Created
  13. Additional Comments : modify the pixer to 800X600@72Hz
  14. ==============================================================================*/
  15. module vga_module(
  16.         input                 i_fpga_clk        ,        //50MHz
  17.         input                 i_rst_n                        ,        //低電平復位
  18.                        
  19.         output                 o_vga_red                ,
  20.         output                 o_vga_green        ,
  21.         output                 o_vga_blue        ,
  22.         output                 o_vga_hsync        ,        //行同步信號
  23.         output                 o_vga_vsync                //場同步信號
  24. );

  26. //================================================================================
  27. // 4、Wire and reg declaration
  28. //================================================================================
  29.         reg[9:0] r_x_cnt;        //行坐標（這里包括了行同步、后沿、有效數據區、前沿）
  30.         reg[9:0] r_y_cnt;        //列坐標（這里包括了場同步、后沿、有效數據區、前沿）
  31. always @ (posedge i_fpga_clk or negedge i_rst_n)
  32.         if(!i_rst_n)
  33.                 r_x_cnt <= 10'd0;
  34.         else if(r_x_cnt == 10'd1000)
  35.                 r_x_cnt <= 10'd0;                //行計數只記到1000
  36.         else
  37.                 r_x_cnt <= r_x_cnt+1'b1;

  39. always @ (posedge i_fpga_clk or negedge i_rst_n)
  40.         if(!i_rst_n)
  41.                 r_y_cnt <= 10'd0;
  42.         else if(r_y_cnt == 10'd665)
  43.                 r_y_cnt <= 10'd0;                //場同步只記到665
  44.         else if(r_x_cnt == 10'd1000)
  45.                 r_y_cnt <= r_y_cnt+1'b1;//每計數完一行，場同步就加一
  46.         else
  47.                 r_y_cnt <= r_y_cnt;
  48.                
  49. //================================================================================
  50. // 4、Wire and reg declaration
  51. //================================================================================
  52.         wire w_vga_valid;        //有效數據顯示區標志，當坐標不處于有效顯示區時，R、G、B三原色信號接的電平都必須拉底（0）*/
  53. assign w_vga_valid = (r_x_cnt > 10'd180) && (r_x_cnt < 10'd980) //800*600
  54.                                         && (r_y_cnt > 10'd35) && (r_y_cnt < 10'd635);

  56.         wire        [9:0] w_x_pos;
  57.         wire        [9:0]        w_y_pos;        //有效顯示區坐標
  58. assign w_x_pos = r_x_cnt-10'd180;//
  59. assign w_y_pos = r_y_cnt-10'd35;//

  61.         reg         r_vga_hsync;
  62.         reg                r_vga_vsync;
  63. always @ (posedge i_fpga_clk or negedge i_rst_n)
  64.   if (!i_rst_n)
  65.           begin
  66.                         r_vga_hsync <= 1'b0;
  67.              r_vga_vsync <= 1'b0;
  68.      end
  69.   else
  70.           begin
  71.              r_vga_hsync <= r_x_cnt <= 10'd50;  //產生hsync信號（行同步）0-50
  72.              r_vga_vsync <= r_y_cnt <= 10'd6;   //產生vsync信號（場同步）0-6
  73.     end

  75. //================================================================================
  76. // 4、Wire and reg declaration
  77. //================================================================================
  78.         //顯示一個矩形框
  79.         wire a_dis,b_dis,c_dis,d_dis;        //矩形框顯示區域定位
  80. assign a_dis = ( (w_x_pos>=200) && (w_x_pos<=220) )
  81.                                 &&        ( (w_y_pos>=140) && (w_y_pos<=460) );                               
  82. assign b_dis = ( (w_x_pos>=580) && (w_x_pos<=600) )
  83.                                 && ( (w_y_pos>=140) && (w_y_pos<=460) );
  84. assign c_dis = ( (w_x_pos>=220) && (w_x_pos<=580) )
  85.                                 &&        ( (w_y_pos>140)  && (w_y_pos<=160) );                               
  86. assign d_dis = ( (w_x_pos>=220) && (w_x_pos<=580) )
  87.                                 && ( (w_y_pos>=440) && (w_y_pos<=460) );

  89.         wire e_dis,f_dis,g_dis,h_dis;        //矩形框顯示區域定位
  90. assign e_dis = ( (w_x_pos>=320) && (w_x_pos<=340) )
  91.                                 &&        ( (w_y_pos>=320) && (w_y_pos<=410) );                               
  92. assign f_dis = ( (w_x_pos>=460) && (w_x_pos<=480) )
  93.                                 && ( (w_y_pos>=320) && (w_y_pos<=410) );
  94. assign g_dis = ( (w_x_pos>=340) && (w_x_pos<=460) )
  95.                                 &&        ( (w_y_pos>320)  && (w_y_pos<=340) );                               
  96. assign h_dis = ( (w_x_pos>=340) && (w_x_pos<=460) )
  97.                                 && ( (w_y_pos>=390) && (w_y_pos<=410) );

  99.         wire i_dis,j_dis,k_dis,l_dis;
  100. assign i_dis = ( (w_x_pos>=320) && (w_x_pos<=340) )
  101.                                 &&        ( (w_y_pos>=210) && (w_y_pos<=290) );                               
  102. assign j_dis = ( (w_x_pos>=460) && (w_x_pos<=480) )
  103.                                 && ( (w_y_pos>=210) && (w_y_pos<=290) );
  104. assign k_dis = ( (w_x_pos>=270) && (w_x_pos<=320) )
  105.                                 &&        ( (w_y_pos>270)  && (w_y_pos<=290) );                               
  106. assign l_dis = ( (w_x_pos>=480) && (w_x_pos<=530) )
  107.                                 && ( (w_y_pos>=270) && (w_y_pos<=290) );

  109. //================================================================================
  110. // 2、output                                                                  
  111. //================================================================================

  113.         assign o_vga_red = w_vga_valid ?        (i_dis | j_dis | k_dis | l_dis): 1'b0;
  114.         assign o_vga_blue = w_vga_valid ?  (a_dis | b_dis | c_dis | d_dis | e_dis | f_dis | g_dis | h_dis ) : 1'b0;
  115.         assign o_vga_green = w_vga_valid ? ~(a_dis | b_dis | c_dis | d_dis | e_dis | f_dis | g_dis | h_dis | i_dis | j_dis | k_dis | l_dis) : 1'b0;          
  116.         assign o_vga_vsync = r_vga_vsync ;
  117.         assign o_vga_hsync = r_vga_hsync ;
  118.        
  119. //================================================================================
  120. endmodule
復制代碼

全部資料51hei下載地址：
M20_VGA display.zip (4.48 MB, 下載次數: 65)


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