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發(fā)布時(shí)間: 2018-7-9 18:40
正文摘要:摘 要:提出了一種提取位同步時(shí)鐘的改進(jìn)方法， 通過(guò)在數(shù)字鎖相環(huán)的鑒相器和控制器之間添加數(shù)字濾波器， 減少了同步鎖定后的抖動(dòng)現(xiàn)象和隨機(jī)噪聲引起的相位抖動(dòng)現(xiàn)象 使用 FPGA 芯片 采用 VHDL 硬件描述語(yǔ)言完成了系統(tǒng)設(shè) ... |
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