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標題: 8位加法計數器 vhdl程序 [打印本頁]
作者: feiyang25    時間: 2016-11-13 00:07
標題: 8位加法計數器 vhdl程序
8位加法計數器 vhdl程序

  1. module cnt10 (clk,rst,en,load,cout,dout,data);
  2.   input clk,rst,en,load;
  3.   input[7:0] data;
  4.   output[7:0] dout;
  5.   output cout;
  6.   reg[7:0] q1; reg cout;
  7.   assign dout = q1;
  8.   always @(posedge clk or negedge rst or negedge load)
  9.     begin
  10.        if (!rst)  q1 <= 0;
  11.        else if (!load)  q1 <= data;
  12.     else if (en) begin
  13.          
  14.          
  15.     if (q1<9) q1<=q1+1;
  16.     else q1 <= 8'b00000000; end
  17.     end
  18.    always @(q1)
  19.       if (q1==4'h9) cout = 1'b1;
  20.     else cout = 1'b0;
  21. endmodule
復制代碼

8位加法計數器.zip

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作者: lin116    時間: 2017-3-23 02:55
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