標(biāo)題: 高速電路設(shè)計面臨的問題 [打印本頁]
作者: qq8426030 時間: 2013-11-28 10:55
標(biāo)題: 高速電路設(shè)計面臨的問題
高速電路設(shè)計面臨的問題
伴隨著半導(dǎo)體技術(shù)的快速發(fā)展,時鐘頻率越來越高。目前,超過一半的數(shù)字系統(tǒng)的時鐘頻率高于100 MHz。另—方面,從半導(dǎo)體芯片封裝的發(fā)展來看,芯片體積越來越小、集成度越來越高、引腳數(shù)越來越多。所以,在當(dāng)今的電路設(shè)計領(lǐng)域,電路系統(tǒng)正朝著大規(guī)模、小體積、高速度、高密度的方向飛速發(fā)展。這樣就帶來了一個問題,即芯片的體積減小導(dǎo)致電路的布局、布線很困難,而信號的頻率還在逐年增高,邊沿速率越來越快,PCB上的電磁現(xiàn)象更復(fù)雜,適用于低速電路的電路理論知識(如基爾霍夫電壓/電流定律)可能己失去作用。此外,電子設(shè)備越來越廣泛地應(yīng)用于人們的工作和生活之中,電子設(shè)備工作的電磁環(huán)境越來越復(fù)雜,電磁兼容問題越來越重要。
總之,電子技術(shù)的發(fā)展給高速數(shù)字系統(tǒng)設(shè)計帶來了挑戰(zhàn),作為高速電路設(shè)計的工程師們,將不可避免地面臨-些新的問題。
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