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標(biāo)題: Verilog語(yǔ)法 [打印本頁(yè)]

作者: qaz123456... 時(shí)間: 2021-6-2 15:59
標(biāo)題: Verilog語(yǔ)法
在Verilog語(yǔ)法中，主要有三大類(lèi)數(shù)據(jù)類(lèi)型，即寄存器類(lèi)型、線網(wǎng)類(lèi)型和參數(shù)類(lèi)型。
寄存器類(lèi)型
   寄存器類(lèi)型表示一個(gè)抽象的數(shù)據(jù)存儲(chǔ)單元，只能在always語(yǔ)句和initial語(yǔ)句中被賦值，并且它的值從一個(gè)賦值到另一個(gè)賦值過(guò)程中被保存下來(lái)。如果該過(guò)程語(yǔ)句描述的是時(shí)序邏輯，即always語(yǔ)句帶有時(shí)鐘信號(hào)，則該寄存器變量對(duì)應(yīng)為寄存器；如果該過(guò)程語(yǔ)句描述的是組合邏輯，即always語(yǔ)句不帶有時(shí)鐘信號(hào)，則該寄存器變量對(duì)應(yīng)為硬件連線；寄存器類(lèi)型的缺省值是x（未知狀態(tài)）。寄存器數(shù)據(jù)類(lèi)型有很多種，如reg、integer、real等，其中最常用的就是reg類(lèi)型。
線網(wǎng)類(lèi)型
   線網(wǎng)表示Verilog結(jié)構(gòu)化元件間的物理連線。它的值由驅(qū)動(dòng)元件的值決定，例如連續(xù)賦值或門(mén)的輸出。如果沒(méi)有驅(qū)動(dòng)元件連接到線網(wǎng)，線網(wǎng)的缺省值為z（高阻態(tài)）。線網(wǎng)類(lèi)型同寄存器類(lèi)型一樣也是有很多種，如tri和wire等，其中最常用的就是wire類(lèi)型。

參數(shù)類(lèi)型
   我們?cè)賮?lái)看下參數(shù)類(lèi)型，參數(shù)其實(shí)就是一個(gè)常量，常被用于定義狀態(tài)機(jī)的狀態(tài)、數(shù)據(jù)位寬和延遲大小等，由于它可以在編譯時(shí)修改參數(shù)的值，因此它又常被用于一些參數(shù)可調(diào)的模塊中，使用戶在實(shí)例化模塊時(shí)，可以根據(jù)需要配置參數(shù)。在定義參數(shù)時(shí)，我們可以一次定義多個(gè)參數(shù)，參數(shù)與參數(shù)之間需要用逗號(hào)隔開(kāi)。這里我們需要注意的是參數(shù)的定義是局部的，只在當(dāng)前模塊中有效。

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