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標題: 簡單的FPGA計時器例程 [打印本頁]

作者: 鬼木士 時間: 2018-10-21 10:51
標題: 簡單的FPGA計時器例程

關鍵代碼
module Accumulator
(
      CLK,RSTn,Result

);

      input                               CLK;
      input                               RSTn;
      output reg[7:0]       Result;


      always@(posedge CLK or negedge RSTn)
            begin
                     if(!RSTn)
                              begin
//                                     Result[7:4]<=0;
//                                     Result[3:0]<=0;
                              end
                     else if(Result[3:0]==4'd9)
                              begin
                                    Result[3:0]<=0;
                                    Result[7:4]<=Result[7:4]+1'b1;
                              end
                     else
                              Result[3:0]<=Result[3:0]+1'b1;
            end


endmodule

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