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標題: FPGA問題:verilog語言怎么實現四位數碼管顯示 [打印本頁]

作者: 宮梓萱 時間: 2017-12-25 09:04
標題: FPGA問題:verilog語言怎么實現四位數碼管顯示
在verilog語言中，假如要實現四位數碼管顯示，該怎么實現了。比如data=20'd1995;
這個數怎么顯示在數碼管上。我所要問的重點是如何把這1995這四個數都分離出來，
不要求余的方法，采用其他方法。
望各位教教小弟~~~~

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