標(biāo)題: STM32最小系統(tǒng)布線注意事項(xiàng) [打印本頁(yè)]
作者: lht200591 時(shí)間: 2017-12-10 14:33
標(biāo)題: STM32最小系統(tǒng)布線注意事項(xiàng)
STM32最小系統(tǒng)布線注意事項(xiàng)
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- 1、 VSSA,VDDA
- VSSA,VDDA = 2.0~3.6V:為ADC、復(fù)位模塊、RC振蕩器和PLL的模擬部分提供供電。使用ADC時(shí),VDD不得小于2.4V。VDDA和VSSA必須分別連接到VDD和VSS,VDDA管腳必須連接到2個(gè)外部的去藕電容器(10nF瓷介電容+1μF的鉭電容或瓷介電容),VDDA管腳必須連接到2個(gè)外部的去藕電容器(10nF瓷介電容+1μF的鉭電容或瓷介電容)。每一對(duì)VDD和VSS管腳都需要使用單獨(dú)的去藕電容。每對(duì)VDD與VSS都必須在盡可能靠近芯片處分別放置一個(gè)10nF~100nF的高頻瓷介電容。在靠近VDD3和VSS3的地方放置一個(gè)4.7μF~10μF的鉭電容或瓷介電容。VDD與VDDA之間的電壓差不能超過(guò)300mV。典型連接:
盡管所有VDD和所有VSS在內(nèi)部相連,在芯片外部仍然需要連接上所有的VDD和VSS因?yàn)閷?dǎo)線較細(xì),內(nèi)部連接負(fù)載能力較差,抗干擾的能力也較差,如果漏接VDD或VSS,容易造成內(nèi)部線路損壞,同時(shí)抗干擾能力下降。
電源線和地線之間連接具有良好高頻特性的電容,即在靠近電源一端應(yīng)放置一個(gè)0.1μF(104電容)和一個(gè)1~10μF的電容。
采用LM1117-3.3V(AMS1117)供電
2、I/O引腳間的串?dāng)_:模擬信號(hào)線的周圍布置地線產(chǎn)生屏蔽,能有效地減小串?dāng)_干擾噪聲
- 復(fù)位信號(hào)低脈沖至少保持300ns
- 在產(chǎn)生內(nèi)部復(fù)位信號(hào)時(shí),NRST引腳會(huì)輸出一個(gè)低電平
- 外部復(fù)位電路不能妨礙內(nèi)部脈沖 發(fā)生器的輸出
復(fù)位電路如下圖所示:
3、BOOT0,BOOT1管腳
兩個(gè)管腳在芯片復(fù)位時(shí)的電平狀態(tài)決定了芯片復(fù)位后從哪個(gè)區(qū)域開始執(zhí)行程序。
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| | 從系統(tǒng)存儲(chǔ)器啟,此模式啟動(dòng)的程序功能由廠家設(shè)置。 |
| | 從內(nèi)置SRAM啟動(dòng),這種模式可以用于調(diào)試。 |
一般BOOT0和BOOT1跳線都跳到0(地)。只是在ISP下載的情況下,BOOT0=1,BOOT1=0 ,下載完成后,把BOOT0的跳線接回0,也即BOOT0=0,BOOT1=0 。
ISP下載電路:
- nJTRST、JTDI、JTMS/SWDIO和JTDO引腳推薦使用10K電阻上拉至VDD,JTCK/SWCLK引腳推薦使用10K電阻下拉至VSS。
- 仿真工具(STLink,JLink)通過(guò)20個(gè)腳插座的1號(hào)腳判斷目標(biāo)板是否供電,通過(guò)19號(hào)腳可以向目標(biāo)板供電(3.3V,<100mA)。
- 第1和第2管腳接VDD,其實(shí)是對(duì)應(yīng)74HC244的芯片電壓,如果74244采用的3.3V的低壓芯片的話,這個(gè)JTAG-VDD就接3.3V。如果采用的是5V電壓的74244的話,這個(gè)JTAG-VDD就是5V。
5、RTC時(shí)鐘電路
RTC時(shí)鐘要求使用的32.768振蕩器的寄生電容是6pF,這個(gè)電容區(qū)別于振蕩器外部接的負(fù)載電容;
6、FSMC
對(duì)應(yīng)100pin或144pin,FSMC的功能與I2C是存在沖突的,如果FSMC時(shí)鐘打開,I2C 1的硬件模式無(wú)法工作。這在STM32F10xxx的勘誤表中是有描述的。
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作者: ybybybyb 時(shí)間: 2017-12-21 22:51
ok,,,,,,,,,,,,,,,,,,,,,,
作者: carlyvin 時(shí)間: 2017-12-25 11:48
很實(shí)用
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